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A design methodology for automatic generation of processor arrays based on the polytope model
JUAN MANUEL CAMPOS DIAZ
ARMANDO CRUZ PEREZ
Acceso Abierto
Atribución-NoComercial-SinDerivadas
Los dispositivos de cómputo móvil y el acceso a recursos multimedia han impulsado el desarrollo de arquitecturas de hardware flexibles y eficientes con respecto al consumo de potencia. Además, la imposibilidad de incrementar indefinidamente la frecuencia operativa de los procesadores ha hecho necesarios nuevos esquemas de diseño para aumentar su capacidad de cómputo. Las metodologías para paralelización automática permiten generar arreglos de procesadores que responden a ciertos parámetros como consumo de potencia, área de implementación y velocidad de procesamiento a partir de una definición algorítmica. Mucho trabajo de investigación se ha centrado en la paralelización de lazo debido a que una gran cantidad de programas requiren la ejecución de las mismas operaciones sobre una gran cantidad de datos diferentes. Por ejemplo, procesamiento de imágenes y procesamiento digital de señales. En este trabajo de investigación se ha desarrollado una metodología para paralelización automática en el ámbito de lazos. Con dicha metodologa es posible generar versiones arquitecturales como solución a un mismo problema. Estas versiones presentan diferentes características estableciendo compromisos entre el número de datos procesados por unidad de tiempo y el área de implementación. Las principales contribuciones de esta investigación son: Un método automático para calendarizar los cálculos de un algoritmo y asignar los recursos físicos necesarios en el ámbito de lazos as como un esquema de compresión que permite reducir el tamaño de un arreglo de procesadores. I
Instituto Nacional de Astrofísica, Óptica y Electrónica
2014-02
Tesis de doctorado
Inglés
CIENCIA DE LOS ORDENADORES
Versión aceptada
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Aparece en las colecciones: Maestría en Óptica

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